TimeQuest Timing Analyzer report for test
Sat Jun 09 12:51:20 2012
Quartus II 64-Bit Version 11.1 Build 173 11/01/2011 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. TimeQuest Timing Analyzer Summary
  3. Parallel Compilation
  4. Clocks
  5. Slow Model Fmax Summary
  6. Slow Model Setup Summary
  7. Slow Model Hold Summary
  8. Slow Model Recovery Summary
  9. Slow Model Removal Summary
 10. Slow Model Minimum Pulse Width Summary
 11. Propagation Delay
 12. Minimum Propagation Delay
 13. Fast Model Setup Summary
 14. Fast Model Hold Summary
 15. Fast Model Recovery Summary
 16. Fast Model Removal Summary
 17. Fast Model Minimum Pulse Width Summary
 18. Propagation Delay
 19. Minimum Propagation Delay
 20. Multicorner Timing Analysis Summary
 21. Progagation Delay
 22. Minimum Progagation Delay
 23. Clock Transfers
 24. Report TCCS
 25. Report RSKM
 26. Unconstrained Paths
 27. TimeQuest Timing Analyzer Messages



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; Legal Notice ;
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Copyright (C) 1991-2011 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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programming logic devices manufactured by Altera and sold by 
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; TimeQuest Timing Analyzer Summary                                      ;
+--------------------+---------------------------------------------------+
; Quartus II Version ; Version 11.1 Build 173 11/01/2011 SJ Full Version ;
; Revision Name      ; test                                              ;
; Device Family      ; Cyclone II                                        ;
; Device Name        ; EP2C35F672C6                                      ;
; Timing Models      ; Final                                             ;
; Delay Model        ; Combined                                          ;
; Rise/Fall Delays   ; Unavailable                                       ;
+--------------------+---------------------------------------------------+


Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 2      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


----------
; Clocks ;
----------
No clocks to report.


---------------------------
; Slow Model Fmax Summary ;
---------------------------
No paths to report.


----------------------------
; Slow Model Setup Summary ;
----------------------------
No paths to report.


---------------------------
; Slow Model Hold Summary ;
---------------------------
No paths to report.


-------------------------------
; Slow Model Recovery Summary ;
-------------------------------
No paths to report.


------------------------------
; Slow Model Removal Summary ;
------------------------------
No paths to report.


------------------------------------------
; Slow Model Minimum Pulse Width Summary ;
------------------------------------------
No paths to report.


+--------------------------------------------------------------+
; Propagation Delay                                            ;
+------------+-------------+--------+--------+--------+--------+
; Input Port ; Output Port ; RR     ; RF     ; FR     ; FF     ;
+------------+-------------+--------+--------+--------+--------+
; SW0        ; LEDR[7]     ; 14.092 ; 14.092 ; 14.092 ; 14.092 ;
; SW0        ; LEDR[8]     ; 12.932 ; 12.932 ; 12.932 ; 12.932 ;
; SW0        ; LEDR[9]     ; 12.940 ; 12.940 ; 12.940 ; 12.940 ;
; SW0        ; LEDR[10]    ; 12.999 ; 12.999 ; 12.999 ; 12.999 ;
; SW0        ; LEDR[11]    ; 12.936 ; 12.936 ; 12.936 ; 12.936 ;
; SW0        ; LEDR[12]    ; 12.947 ; 12.947 ; 12.947 ; 12.947 ;
; SW0        ; LEDR[13]    ; 12.957 ; 12.957 ; 12.957 ; 12.957 ;
; SW0        ; LEDR[14]    ; 13.306 ; 13.306 ; 13.306 ; 13.306 ;
; SW0        ; LEDR[15]    ; 13.298 ; 13.298 ; 13.298 ; 13.298 ;
; SW1        ; LEDR[8]     ; 11.640 ; 11.640 ; 11.640 ; 11.640 ;
; SW1        ; LEDR[9]     ; 11.648 ; 11.648 ; 11.648 ; 11.648 ;
; SW1        ; LEDR[10]    ; 11.707 ; 11.707 ; 11.707 ; 11.707 ;
; SW1        ; LEDR[11]    ; 11.644 ; 11.644 ; 11.644 ; 11.644 ;
; SW1        ; LEDR[12]    ; 11.655 ; 11.655 ; 11.655 ; 11.655 ;
; SW1        ; LEDR[13]    ; 11.665 ; 11.665 ; 11.665 ; 11.665 ;
; SW1        ; LEDR[14]    ; 12.014 ; 12.014 ; 12.014 ; 12.014 ;
; SW1        ; LEDR[15]    ; 12.006 ; 12.006 ; 12.006 ; 12.006 ;
; SW2        ; LEDR[9]     ; 11.634 ; 11.634 ; 11.634 ; 11.634 ;
; SW2        ; LEDR[10]    ; 11.693 ; 11.693 ; 11.693 ; 11.693 ;
; SW2        ; LEDR[11]    ; 11.630 ; 11.630 ; 11.630 ; 11.630 ;
; SW2        ; LEDR[12]    ; 11.641 ; 11.641 ; 11.641 ; 11.641 ;
; SW2        ; LEDR[13]    ; 11.651 ; 11.651 ; 11.651 ; 11.651 ;
; SW2        ; LEDR[14]    ; 12.000 ; 12.000 ; 12.000 ; 12.000 ;
; SW2        ; LEDR[15]    ; 11.992 ; 11.992 ; 11.992 ; 11.992 ;
; SW3        ; LEDR[10]    ; 11.673 ; 11.673 ; 11.673 ; 11.673 ;
; SW3        ; LEDR[11]    ; 11.610 ; 11.610 ; 11.610 ; 11.610 ;
; SW3        ; LEDR[12]    ; 11.621 ; 11.621 ; 11.621 ; 11.621 ;
; SW3        ; LEDR[13]    ; 11.631 ; 11.631 ; 11.631 ; 11.631 ;
; SW3        ; LEDR[14]    ; 11.980 ; 11.980 ; 11.980 ; 11.980 ;
; SW3        ; LEDR[15]    ; 11.972 ; 11.972 ; 11.972 ; 11.972 ;
; SW4        ; LEDR[11]    ; 11.839 ; 11.839 ; 11.839 ; 11.839 ;
; SW4        ; LEDR[12]    ; 11.850 ; 11.850 ; 11.850 ; 11.850 ;
; SW4        ; LEDR[13]    ; 11.860 ; 11.860 ; 11.860 ; 11.860 ;
; SW4        ; LEDR[14]    ; 12.209 ; 12.209 ; 12.209 ; 12.209 ;
; SW4        ; LEDR[15]    ; 12.201 ; 12.201 ; 12.201 ; 12.201 ;
; SW5        ; LEDR[12]    ; 11.643 ; 11.643 ; 11.643 ; 11.643 ;
; SW5        ; LEDR[13]    ; 11.653 ; 11.653 ; 11.653 ; 11.653 ;
; SW5        ; LEDR[14]    ; 12.002 ; 12.002 ; 12.002 ; 12.002 ;
; SW5        ; LEDR[15]    ; 11.994 ; 11.994 ; 11.994 ; 11.994 ;
; SW6        ; LEDR[13]    ; 11.646 ; 11.646 ; 11.646 ; 11.646 ;
; SW6        ; LEDR[14]    ; 11.995 ; 11.995 ; 11.995 ; 11.995 ;
; SW6        ; LEDR[15]    ; 11.987 ; 11.987 ; 11.987 ; 11.987 ;
; SW7        ; LEDR[14]    ; 12.009 ; 12.009 ; 12.009 ; 12.009 ;
; SW7        ; LEDR[15]    ; 12.001 ; 12.001 ; 12.001 ; 12.001 ;
+------------+-------------+--------+--------+--------+--------+


+--------------------------------------------------------------+
; Minimum Propagation Delay                                    ;
+------------+-------------+--------+--------+--------+--------+
; Input Port ; Output Port ; RR     ; RF     ; FR     ; FF     ;
+------------+-------------+--------+--------+--------+--------+
; SW0        ; LEDR[7]     ; 14.092 ; 14.092 ; 14.092 ; 14.092 ;
; SW0        ; LEDR[8]     ; 12.932 ; 12.932 ; 12.932 ; 12.932 ;
; SW0        ; LEDR[9]     ; 12.940 ; 12.940 ; 12.940 ; 12.940 ;
; SW0        ; LEDR[10]    ; 12.999 ; 12.999 ; 12.999 ; 12.999 ;
; SW0        ; LEDR[11]    ; 12.936 ; 12.936 ; 12.936 ; 12.936 ;
; SW0        ; LEDR[12]    ; 12.947 ; 12.947 ; 12.947 ; 12.947 ;
; SW0        ; LEDR[13]    ; 12.957 ; 12.957 ; 12.957 ; 12.957 ;
; SW0        ; LEDR[14]    ; 13.306 ; 13.306 ; 13.306 ; 13.306 ;
; SW0        ; LEDR[15]    ; 13.298 ; 13.298 ; 13.298 ; 13.298 ;
; SW1        ; LEDR[8]     ; 11.640 ; 11.640 ; 11.640 ; 11.640 ;
; SW1        ; LEDR[9]     ; 11.648 ; 11.648 ; 11.648 ; 11.648 ;
; SW1        ; LEDR[10]    ; 11.707 ; 11.707 ; 11.707 ; 11.707 ;
; SW1        ; LEDR[11]    ; 11.644 ; 11.644 ; 11.644 ; 11.644 ;
; SW1        ; LEDR[12]    ; 11.655 ; 11.655 ; 11.655 ; 11.655 ;
; SW1        ; LEDR[13]    ; 11.665 ; 11.665 ; 11.665 ; 11.665 ;
; SW1        ; LEDR[14]    ; 12.014 ; 12.014 ; 12.014 ; 12.014 ;
; SW1        ; LEDR[15]    ; 12.006 ; 12.006 ; 12.006 ; 12.006 ;
; SW2        ; LEDR[9]     ; 11.634 ; 11.634 ; 11.634 ; 11.634 ;
; SW2        ; LEDR[10]    ; 11.693 ; 11.693 ; 11.693 ; 11.693 ;
; SW2        ; LEDR[11]    ; 11.630 ; 11.630 ; 11.630 ; 11.630 ;
; SW2        ; LEDR[12]    ; 11.641 ; 11.641 ; 11.641 ; 11.641 ;
; SW2        ; LEDR[13]    ; 11.651 ; 11.651 ; 11.651 ; 11.651 ;
; SW2        ; LEDR[14]    ; 12.000 ; 12.000 ; 12.000 ; 12.000 ;
; SW2        ; LEDR[15]    ; 11.992 ; 11.992 ; 11.992 ; 11.992 ;
; SW3        ; LEDR[10]    ; 11.673 ; 11.673 ; 11.673 ; 11.673 ;
; SW3        ; LEDR[11]    ; 11.610 ; 11.610 ; 11.610 ; 11.610 ;
; SW3        ; LEDR[12]    ; 11.621 ; 11.621 ; 11.621 ; 11.621 ;
; SW3        ; LEDR[13]    ; 11.631 ; 11.631 ; 11.631 ; 11.631 ;
; SW3        ; LEDR[14]    ; 11.980 ; 11.980 ; 11.980 ; 11.980 ;
; SW3        ; LEDR[15]    ; 11.972 ; 11.972 ; 11.972 ; 11.972 ;
; SW4        ; LEDR[11]    ; 11.839 ; 11.839 ; 11.839 ; 11.839 ;
; SW4        ; LEDR[12]    ; 11.850 ; 11.850 ; 11.850 ; 11.850 ;
; SW4        ; LEDR[13]    ; 11.860 ; 11.860 ; 11.860 ; 11.860 ;
; SW4        ; LEDR[14]    ; 12.209 ; 12.209 ; 12.209 ; 12.209 ;
; SW4        ; LEDR[15]    ; 12.201 ; 12.201 ; 12.201 ; 12.201 ;
; SW5        ; LEDR[12]    ; 11.643 ; 11.643 ; 11.643 ; 11.643 ;
; SW5        ; LEDR[13]    ; 11.653 ; 11.653 ; 11.653 ; 11.653 ;
; SW5        ; LEDR[14]    ; 12.002 ; 12.002 ; 12.002 ; 12.002 ;
; SW5        ; LEDR[15]    ; 11.994 ; 11.994 ; 11.994 ; 11.994 ;
; SW6        ; LEDR[13]    ; 11.646 ; 11.646 ; 11.646 ; 11.646 ;
; SW6        ; LEDR[14]    ; 11.995 ; 11.995 ; 11.995 ; 11.995 ;
; SW6        ; LEDR[15]    ; 11.987 ; 11.987 ; 11.987 ; 11.987 ;
; SW7        ; LEDR[14]    ; 12.009 ; 12.009 ; 12.009 ; 12.009 ;
; SW7        ; LEDR[15]    ; 12.001 ; 12.001 ; 12.001 ; 12.001 ;
+------------+-------------+--------+--------+--------+--------+


----------------------------
; Fast Model Setup Summary ;
----------------------------
No paths to report.


---------------------------
; Fast Model Hold Summary ;
---------------------------
No paths to report.


-------------------------------
; Fast Model Recovery Summary ;
-------------------------------
No paths to report.


------------------------------
; Fast Model Removal Summary ;
------------------------------
No paths to report.


------------------------------------------
; Fast Model Minimum Pulse Width Summary ;
------------------------------------------
No paths to report.


+----------------------------------------------------------+
; Propagation Delay                                        ;
+------------+-------------+-------+-------+-------+-------+
; Input Port ; Output Port ; RR    ; RF    ; FR    ; FF    ;
+------------+-------------+-------+-------+-------+-------+
; SW0        ; LEDR[7]     ; 6.938 ; 6.938 ; 6.938 ; 6.938 ;
; SW0        ; LEDR[8]     ; 6.406 ; 6.406 ; 6.406 ; 6.406 ;
; SW0        ; LEDR[9]     ; 6.414 ; 6.414 ; 6.414 ; 6.414 ;
; SW0        ; LEDR[10]    ; 6.455 ; 6.455 ; 6.455 ; 6.455 ;
; SW0        ; LEDR[11]    ; 6.412 ; 6.412 ; 6.412 ; 6.412 ;
; SW0        ; LEDR[12]    ; 6.422 ; 6.422 ; 6.422 ; 6.422 ;
; SW0        ; LEDR[13]    ; 6.429 ; 6.429 ; 6.429 ; 6.429 ;
; SW0        ; LEDR[14]    ; 6.611 ; 6.611 ; 6.611 ; 6.611 ;
; SW0        ; LEDR[15]    ; 6.607 ; 6.607 ; 6.607 ; 6.607 ;
; SW1        ; LEDR[8]     ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW1        ; LEDR[9]     ; 5.695 ; 5.695 ; 5.695 ; 5.695 ;
; SW1        ; LEDR[10]    ; 5.736 ; 5.736 ; 5.736 ; 5.736 ;
; SW1        ; LEDR[11]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW1        ; LEDR[12]    ; 5.703 ; 5.703 ; 5.703 ; 5.703 ;
; SW1        ; LEDR[13]    ; 5.710 ; 5.710 ; 5.710 ; 5.710 ;
; SW1        ; LEDR[14]    ; 5.892 ; 5.892 ; 5.892 ; 5.892 ;
; SW1        ; LEDR[15]    ; 5.888 ; 5.888 ; 5.888 ; 5.888 ;
; SW2        ; LEDR[9]     ; 5.689 ; 5.689 ; 5.689 ; 5.689 ;
; SW2        ; LEDR[10]    ; 5.730 ; 5.730 ; 5.730 ; 5.730 ;
; SW2        ; LEDR[11]    ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW2        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW2        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW2        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW2        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[10]    ; 5.726 ; 5.726 ; 5.726 ; 5.726 ;
; SW3        ; LEDR[11]    ; 5.683 ; 5.683 ; 5.683 ; 5.683 ;
; SW3        ; LEDR[12]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW3        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW3        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW4        ; LEDR[11]    ; 5.779 ; 5.779 ; 5.779 ; 5.779 ;
; SW4        ; LEDR[12]    ; 5.789 ; 5.789 ; 5.789 ; 5.789 ;
; SW4        ; LEDR[13]    ; 5.796 ; 5.796 ; 5.796 ; 5.796 ;
; SW4        ; LEDR[14]    ; 5.978 ; 5.978 ; 5.978 ; 5.978 ;
; SW4        ; LEDR[15]    ; 5.974 ; 5.974 ; 5.974 ; 5.974 ;
; SW5        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW5        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW5        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW5        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW6        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW7        ; LEDR[14]    ; 5.899 ; 5.899 ; 5.899 ; 5.899 ;
; SW7        ; LEDR[15]    ; 5.895 ; 5.895 ; 5.895 ; 5.895 ;
+------------+-------------+-------+-------+-------+-------+


+----------------------------------------------------------+
; Minimum Propagation Delay                                ;
+------------+-------------+-------+-------+-------+-------+
; Input Port ; Output Port ; RR    ; RF    ; FR    ; FF    ;
+------------+-------------+-------+-------+-------+-------+
; SW0        ; LEDR[7]     ; 6.938 ; 6.938 ; 6.938 ; 6.938 ;
; SW0        ; LEDR[8]     ; 6.406 ; 6.406 ; 6.406 ; 6.406 ;
; SW0        ; LEDR[9]     ; 6.414 ; 6.414 ; 6.414 ; 6.414 ;
; SW0        ; LEDR[10]    ; 6.455 ; 6.455 ; 6.455 ; 6.455 ;
; SW0        ; LEDR[11]    ; 6.412 ; 6.412 ; 6.412 ; 6.412 ;
; SW0        ; LEDR[12]    ; 6.422 ; 6.422 ; 6.422 ; 6.422 ;
; SW0        ; LEDR[13]    ; 6.429 ; 6.429 ; 6.429 ; 6.429 ;
; SW0        ; LEDR[14]    ; 6.611 ; 6.611 ; 6.611 ; 6.611 ;
; SW0        ; LEDR[15]    ; 6.607 ; 6.607 ; 6.607 ; 6.607 ;
; SW1        ; LEDR[8]     ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW1        ; LEDR[9]     ; 5.695 ; 5.695 ; 5.695 ; 5.695 ;
; SW1        ; LEDR[10]    ; 5.736 ; 5.736 ; 5.736 ; 5.736 ;
; SW1        ; LEDR[11]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW1        ; LEDR[12]    ; 5.703 ; 5.703 ; 5.703 ; 5.703 ;
; SW1        ; LEDR[13]    ; 5.710 ; 5.710 ; 5.710 ; 5.710 ;
; SW1        ; LEDR[14]    ; 5.892 ; 5.892 ; 5.892 ; 5.892 ;
; SW1        ; LEDR[15]    ; 5.888 ; 5.888 ; 5.888 ; 5.888 ;
; SW2        ; LEDR[9]     ; 5.689 ; 5.689 ; 5.689 ; 5.689 ;
; SW2        ; LEDR[10]    ; 5.730 ; 5.730 ; 5.730 ; 5.730 ;
; SW2        ; LEDR[11]    ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW2        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW2        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW2        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW2        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[10]    ; 5.726 ; 5.726 ; 5.726 ; 5.726 ;
; SW3        ; LEDR[11]    ; 5.683 ; 5.683 ; 5.683 ; 5.683 ;
; SW3        ; LEDR[12]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW3        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW3        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW4        ; LEDR[11]    ; 5.779 ; 5.779 ; 5.779 ; 5.779 ;
; SW4        ; LEDR[12]    ; 5.789 ; 5.789 ; 5.789 ; 5.789 ;
; SW4        ; LEDR[13]    ; 5.796 ; 5.796 ; 5.796 ; 5.796 ;
; SW4        ; LEDR[14]    ; 5.978 ; 5.978 ; 5.978 ; 5.978 ;
; SW4        ; LEDR[15]    ; 5.974 ; 5.974 ; 5.974 ; 5.974 ;
; SW5        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW5        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW5        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW5        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW6        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW7        ; LEDR[14]    ; 5.899 ; 5.899 ; 5.899 ; 5.899 ;
; SW7        ; LEDR[15]    ; 5.895 ; 5.895 ; 5.895 ; 5.895 ;
+------------+-------------+-------+-------+-------+-------+


+----------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary                                        ;
+------------------+-------+------+----------+---------+---------------------+
; Clock            ; Setup ; Hold ; Recovery ; Removal ; Minimum Pulse Width ;
+------------------+-------+------+----------+---------+---------------------+
; Worst-case Slack ; N/A   ; N/A  ; N/A      ; N/A     ; N/A                 ;
; Design-wide TNS  ; 0.0   ; 0.0  ; 0.0      ; 0.0     ; 0.0                 ;
+------------------+-------+------+----------+---------+---------------------+


+--------------------------------------------------------------+
; Progagation Delay                                            ;
+------------+-------------+--------+--------+--------+--------+
; Input Port ; Output Port ; RR     ; RF     ; FR     ; FF     ;
+------------+-------------+--------+--------+--------+--------+
; SW0        ; LEDR[7]     ; 14.092 ; 14.092 ; 14.092 ; 14.092 ;
; SW0        ; LEDR[8]     ; 12.932 ; 12.932 ; 12.932 ; 12.932 ;
; SW0        ; LEDR[9]     ; 12.940 ; 12.940 ; 12.940 ; 12.940 ;
; SW0        ; LEDR[10]    ; 12.999 ; 12.999 ; 12.999 ; 12.999 ;
; SW0        ; LEDR[11]    ; 12.936 ; 12.936 ; 12.936 ; 12.936 ;
; SW0        ; LEDR[12]    ; 12.947 ; 12.947 ; 12.947 ; 12.947 ;
; SW0        ; LEDR[13]    ; 12.957 ; 12.957 ; 12.957 ; 12.957 ;
; SW0        ; LEDR[14]    ; 13.306 ; 13.306 ; 13.306 ; 13.306 ;
; SW0        ; LEDR[15]    ; 13.298 ; 13.298 ; 13.298 ; 13.298 ;
; SW1        ; LEDR[8]     ; 11.640 ; 11.640 ; 11.640 ; 11.640 ;
; SW1        ; LEDR[9]     ; 11.648 ; 11.648 ; 11.648 ; 11.648 ;
; SW1        ; LEDR[10]    ; 11.707 ; 11.707 ; 11.707 ; 11.707 ;
; SW1        ; LEDR[11]    ; 11.644 ; 11.644 ; 11.644 ; 11.644 ;
; SW1        ; LEDR[12]    ; 11.655 ; 11.655 ; 11.655 ; 11.655 ;
; SW1        ; LEDR[13]    ; 11.665 ; 11.665 ; 11.665 ; 11.665 ;
; SW1        ; LEDR[14]    ; 12.014 ; 12.014 ; 12.014 ; 12.014 ;
; SW1        ; LEDR[15]    ; 12.006 ; 12.006 ; 12.006 ; 12.006 ;
; SW2        ; LEDR[9]     ; 11.634 ; 11.634 ; 11.634 ; 11.634 ;
; SW2        ; LEDR[10]    ; 11.693 ; 11.693 ; 11.693 ; 11.693 ;
; SW2        ; LEDR[11]    ; 11.630 ; 11.630 ; 11.630 ; 11.630 ;
; SW2        ; LEDR[12]    ; 11.641 ; 11.641 ; 11.641 ; 11.641 ;
; SW2        ; LEDR[13]    ; 11.651 ; 11.651 ; 11.651 ; 11.651 ;
; SW2        ; LEDR[14]    ; 12.000 ; 12.000 ; 12.000 ; 12.000 ;
; SW2        ; LEDR[15]    ; 11.992 ; 11.992 ; 11.992 ; 11.992 ;
; SW3        ; LEDR[10]    ; 11.673 ; 11.673 ; 11.673 ; 11.673 ;
; SW3        ; LEDR[11]    ; 11.610 ; 11.610 ; 11.610 ; 11.610 ;
; SW3        ; LEDR[12]    ; 11.621 ; 11.621 ; 11.621 ; 11.621 ;
; SW3        ; LEDR[13]    ; 11.631 ; 11.631 ; 11.631 ; 11.631 ;
; SW3        ; LEDR[14]    ; 11.980 ; 11.980 ; 11.980 ; 11.980 ;
; SW3        ; LEDR[15]    ; 11.972 ; 11.972 ; 11.972 ; 11.972 ;
; SW4        ; LEDR[11]    ; 11.839 ; 11.839 ; 11.839 ; 11.839 ;
; SW4        ; LEDR[12]    ; 11.850 ; 11.850 ; 11.850 ; 11.850 ;
; SW4        ; LEDR[13]    ; 11.860 ; 11.860 ; 11.860 ; 11.860 ;
; SW4        ; LEDR[14]    ; 12.209 ; 12.209 ; 12.209 ; 12.209 ;
; SW4        ; LEDR[15]    ; 12.201 ; 12.201 ; 12.201 ; 12.201 ;
; SW5        ; LEDR[12]    ; 11.643 ; 11.643 ; 11.643 ; 11.643 ;
; SW5        ; LEDR[13]    ; 11.653 ; 11.653 ; 11.653 ; 11.653 ;
; SW5        ; LEDR[14]    ; 12.002 ; 12.002 ; 12.002 ; 12.002 ;
; SW5        ; LEDR[15]    ; 11.994 ; 11.994 ; 11.994 ; 11.994 ;
; SW6        ; LEDR[13]    ; 11.646 ; 11.646 ; 11.646 ; 11.646 ;
; SW6        ; LEDR[14]    ; 11.995 ; 11.995 ; 11.995 ; 11.995 ;
; SW6        ; LEDR[15]    ; 11.987 ; 11.987 ; 11.987 ; 11.987 ;
; SW7        ; LEDR[14]    ; 12.009 ; 12.009 ; 12.009 ; 12.009 ;
; SW7        ; LEDR[15]    ; 12.001 ; 12.001 ; 12.001 ; 12.001 ;
+------------+-------------+--------+--------+--------+--------+


+----------------------------------------------------------+
; Minimum Progagation Delay                                ;
+------------+-------------+-------+-------+-------+-------+
; Input Port ; Output Port ; RR    ; RF    ; FR    ; FF    ;
+------------+-------------+-------+-------+-------+-------+
; SW0        ; LEDR[7]     ; 6.938 ; 6.938 ; 6.938 ; 6.938 ;
; SW0        ; LEDR[8]     ; 6.406 ; 6.406 ; 6.406 ; 6.406 ;
; SW0        ; LEDR[9]     ; 6.414 ; 6.414 ; 6.414 ; 6.414 ;
; SW0        ; LEDR[10]    ; 6.455 ; 6.455 ; 6.455 ; 6.455 ;
; SW0        ; LEDR[11]    ; 6.412 ; 6.412 ; 6.412 ; 6.412 ;
; SW0        ; LEDR[12]    ; 6.422 ; 6.422 ; 6.422 ; 6.422 ;
; SW0        ; LEDR[13]    ; 6.429 ; 6.429 ; 6.429 ; 6.429 ;
; SW0        ; LEDR[14]    ; 6.611 ; 6.611 ; 6.611 ; 6.611 ;
; SW0        ; LEDR[15]    ; 6.607 ; 6.607 ; 6.607 ; 6.607 ;
; SW1        ; LEDR[8]     ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW1        ; LEDR[9]     ; 5.695 ; 5.695 ; 5.695 ; 5.695 ;
; SW1        ; LEDR[10]    ; 5.736 ; 5.736 ; 5.736 ; 5.736 ;
; SW1        ; LEDR[11]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW1        ; LEDR[12]    ; 5.703 ; 5.703 ; 5.703 ; 5.703 ;
; SW1        ; LEDR[13]    ; 5.710 ; 5.710 ; 5.710 ; 5.710 ;
; SW1        ; LEDR[14]    ; 5.892 ; 5.892 ; 5.892 ; 5.892 ;
; SW1        ; LEDR[15]    ; 5.888 ; 5.888 ; 5.888 ; 5.888 ;
; SW2        ; LEDR[9]     ; 5.689 ; 5.689 ; 5.689 ; 5.689 ;
; SW2        ; LEDR[10]    ; 5.730 ; 5.730 ; 5.730 ; 5.730 ;
; SW2        ; LEDR[11]    ; 5.687 ; 5.687 ; 5.687 ; 5.687 ;
; SW2        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW2        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW2        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW2        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[10]    ; 5.726 ; 5.726 ; 5.726 ; 5.726 ;
; SW3        ; LEDR[11]    ; 5.683 ; 5.683 ; 5.683 ; 5.683 ;
; SW3        ; LEDR[12]    ; 5.693 ; 5.693 ; 5.693 ; 5.693 ;
; SW3        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW3        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW3        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW4        ; LEDR[11]    ; 5.779 ; 5.779 ; 5.779 ; 5.779 ;
; SW4        ; LEDR[12]    ; 5.789 ; 5.789 ; 5.789 ; 5.789 ;
; SW4        ; LEDR[13]    ; 5.796 ; 5.796 ; 5.796 ; 5.796 ;
; SW4        ; LEDR[14]    ; 5.978 ; 5.978 ; 5.978 ; 5.978 ;
; SW4        ; LEDR[15]    ; 5.974 ; 5.974 ; 5.974 ; 5.974 ;
; SW5        ; LEDR[12]    ; 5.697 ; 5.697 ; 5.697 ; 5.697 ;
; SW5        ; LEDR[13]    ; 5.704 ; 5.704 ; 5.704 ; 5.704 ;
; SW5        ; LEDR[14]    ; 5.886 ; 5.886 ; 5.886 ; 5.886 ;
; SW5        ; LEDR[15]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[13]    ; 5.700 ; 5.700 ; 5.700 ; 5.700 ;
; SW6        ; LEDR[14]    ; 5.882 ; 5.882 ; 5.882 ; 5.882 ;
; SW6        ; LEDR[15]    ; 5.878 ; 5.878 ; 5.878 ; 5.878 ;
; SW7        ; LEDR[14]    ; 5.899 ; 5.899 ; 5.899 ; 5.899 ;
; SW7        ; LEDR[15]    ; 5.895 ; 5.895 ; 5.895 ; 5.895 ;
+------------+-------------+-------+-------+-------+-------+


-------------------
; Clock Transfers ;
-------------------
Nothing to report.


---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design


---------------
; Report RSKM ;
---------------
No dedicated SERDES Receiver circuitry present in device or used in design


+------------------------------------------------+
; Unconstrained Paths                            ;
+---------------------------------+-------+------+
; Property                        ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks                  ; 0     ; 0    ;
; Unconstrained Clocks            ; 0     ; 0    ;
; Unconstrained Input Ports       ; 8     ; 8    ;
; Unconstrained Input Port Paths  ; 44    ; 44   ;
; Unconstrained Output Ports      ; 9     ; 9    ;
; Unconstrained Output Port Paths ; 44    ; 44   ;
+---------------------------------+-------+------+


+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus II 64-Bit TimeQuest Timing Analyzer
    Info: Version 11.1 Build 173 11/01/2011 SJ Full Version
    Info: Processing started: Sat Jun 09 12:51:18 2012
Info: Command: quartus_sta test -c test
Info: qsta_default_script.tcl version: #1
Warning (20028): Parallel compilation is not licensed and has been disabled
Info (21077): Low junction temperature is 0 degrees C
Info (21077): High junction temperature is 85 degrees C
Critical Warning (332012): Synopsys Design Constraints File file not found: 'test.sdc'. A Synopsys Design Constraints File is required by the TimeQuest Timing Analyzer to get proper timing constraints. Without it, the Compiler will not properly optimize the design.
Info (332142): No user constrained base clocks found in the design. Calling "derive_clocks -period 1.0"
Info (332096): The command derive_clocks did not find any clocks to derive.  No clocks were created or changed.
Warning (332068): No clocks defined in design.
Info: Found TIMEQUEST_REPORT_SCRIPT_INCLUDE_DEFAULT_ANALYSIS = ON
Info (332159): No clocks to report
Info: Analyzing Slow Model
Info (332140): No fmax paths to report
Info (332140): No Setup paths to report
Info (332140): No Hold paths to report
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332140): No Minimum Pulse Width paths to report
Info (332001): The selected device family is not supported by the report_metastability command.
Info: Analyzing Fast Model
Info (306004): Started post-fitting delay annotation
Warning (306006): Found 24 output pins without output pin load capacitance assignment
    Info (306007): Pin "LEDG[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDG[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[15]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info (306007): Pin "LEDR[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info (306005): Delay annotation completed successfully
Info (332142): No user constrained base clocks found in the design. Calling "derive_clocks -period 1.0"
Info (332096): The command derive_clocks did not find any clocks to derive.  No clocks were created or changed.
Warning (332068): No clocks defined in design.
Info (332140): No Setup paths to report
Info (332140): No Hold paths to report
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332140): No Minimum Pulse Width paths to report
Info (332001): The selected device family is not supported by the report_metastability command.
Info (332102): Design is not fully constrained for setup requirements
Info (332102): Design is not fully constrained for hold requirements
Info: Quartus II 64-Bit TimeQuest Timing Analyzer was successful. 0 errors, 5 warnings
    Info: Peak virtual memory: 374 megabytes
    Info: Processing ended: Sat Jun 09 12:51:20 2012
    Info: Elapsed time: 00:00:02
    Info: Total CPU time (on all processors): 00:00:01


